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逢甲大學 電子工程學系 洪振傑所指導 陳冠宇的 以電壓控制震盪器為基底的量化器之連續時間三角積分類比數位轉換器 (2021),提出cla35規格關鍵因素是什麼,來自於類比數位轉換器、三角積分調變、連續時間、電壓控制振盪器、多位元量化器。

而第二篇論文國立中山大學 電機工程學系研究所 王朝欽所指導 黃嘉億的 人工智慧適用之具有單指令自動切換加法與乘法運算之單端7T靜態隨機存取記憶體與3D模型資料增強方法之水下物種辨識硬體加速器 (2020),提出因為有 記憶體內運算、無干擾式單端讀寫7T SRAM、漣波進位加乘法單元、3D模型增強式學習、硬體加速器的重點而找出了 cla35規格的解答。

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實用、舒適、 性能,每位想買車的男人勢必都曾在這難解的幾何中苦惱過,AMG帶來全新世代的CLA 35 Shooting Brake,全新的35級距在AMG的硬核中多了幾分柔和,旅行車的空間機能更成了和太座提案時的最大籌碼,但CLA 35 Shooting Brake真能滿足好爸爸們的各方需求嗎?

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以電壓控制震盪器為基底的量化器之連續時間三角積分類比數位轉換器

為了解決cla35規格的問題,作者陳冠宇 這樣論述:

本論文以應用於超音波檢測之生醫用類比數位轉換器(Analog to Digital Converter, ADC)為設計目標,使用TSMC 1P6M 0.18 μm製程設計。醫用超音波常用的信號輸入範圍為2.5 MHz~10 MHz,因此選定輸入信號頻寬為10 MHz,有效位元數需大於12位元以上,並盡可能地降低功耗。為了滿足上述高速、高解析度的條件,ADC架構選擇以三角積分調變(Delta-Sigma, ΔΣ)實現,經由MATLAB模擬後,決定採用三階前饋連續時間系統,取樣頻率為1GHz,超取樣率為50倍,使用電壓控制振盪器(Voltage Control Oscillator,

VCO)為基底的多位元量化器取代內部的快閃式類比數位轉換器。 連續時間系統其內建的抗混疊濾波器可節省元件數量,前饋架構因為其內部的電壓震幅擺動較小,所以運算放大器(Operational Amplifier, OPA)的設計規格可以較為舒緩同時降低功耗。整個三階前饋系統由兩個OPA組成的二階迴路濾波器函數以及VCO量化器自帶的一階函數所構成,選擇VCO做多位元量化器的原因是相較於傳統的三階系統省下了一個OPA的功耗,同時VCO量化器是利用相位差來量化輸入信號,對比於傳統的多位元量化器而言,因不需要額外的參考電壓與分壓,其抵抗製成變異的能力較高,最後其內建的動態元素匹配降低了系統回授端數位

類比轉換器線性度的問題。 整個系統供應電壓為1.8 V,在訊號頻寬10 MHz、取樣頻率1 GHz下,系統SNR達到78.68 dB、SNDR達到76.16 dB、有效位元數(Effective Number of Bits, ENOB)為12.36位元,動態範圍(Dynamic range, DR)達到79.3 dB、功耗為30.7 mW。

人工智慧適用之具有單指令自動切換加法與乘法運算之單端7T靜態隨機存取記憶體與3D模型資料增強方法之水下物種辨識硬體加速器

為了解決cla35規格的問題,作者黃嘉億 這樣論述:

隨著近年來人工智慧帶來的發展,使運算量與運算速度需求不斷增加,故如何在提高運算速度的條件下,降低其運算功率消耗是目前重要的課題。本論文針對傳統儲存單元與計算邏輯單元架構進行改進,提出記憶體內運算架構,與一因應水下環境低功耗需求之水下物件辨識硬體加速器。本論文第一個主題提出記憶體內單指令自動切換加法與乘法運算之1Kb單端讀寫7T SRAM,此架構係利用2T-SWITCH電路與漣波進位加乘法單元(Ripple Carry Adder and Multiplier unit, RCAM unit)實現進位加法與有號數乘法的功能。本電路整合儲存單元與算數邏輯單元,降低其運算能量消耗並維持記憶體內正常

運算功能與操作速度,並以TSMC 40-nm CMOS製程完成下線與量測,量測結果可以達到在操作頻率50 MHz,正常執行記憶體內加法與乘法運算功能。本論文第二個主題提出具8個有效視點3D模型資料增強方法之水下物件辨識硬體加速器,主要為提出一新穎的3D模型資料增強方法,在有限的資源內,建立水下物種資料庫,並利用DNN硬體加速器、傳輸指令的中介控制器(Inter-Controller)及AXI直接存儲器(AXI DMA)建構出水下物件辨識硬體加速器 - UOIDLA,並於Xilinx ZCU102 FPGA開發板上實現裝載了物件辨識模型於水下物件辨識硬體加速器。本電路相比現有設計擁有較小面積與較

低的功耗,分別為52.2 mm²與188.83 mW,最後以TSMC 180-nm CMOS製程完成下線。