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電壓模式直流降壓電源轉換器設計之基礎模型

為了解決dc to dc converter原理的問題，作者高嘉駿 這樣論述：

在這個科技日新月異的時代裡，所有的系統極電子產品除了需具備更多的功能性以外，同時將這些產品走向小型化、微型化，絕對是一個必然且不可逆的趨勢，而SoC(System on Chip)在這個趨勢的浪潮下，絕對是扮演著一個不可或缺的角色。由於現有的系統及電子產品五花八門，而SoC最核心的目的、就是負責將這些系統及電子產品的電路予以積體化，所以想當然Soc的分類也是種類繁多，如專門處理數位訊號的的連線介面匯流排積體電路IC、或專門處理類比訊號的D/A轉換器積體電路IC等等。我們都知道、SoC的最終結果是積體電路IC，而製成積體電路IC的費用與時效都需付出不斐的代價。所以我們必須要在啟動最後硬體生產(

投片)之前，對於這個積體電路IC的特性功能認知與瞭解、以及SoC設計的確認與驗証都是非常重要的。本文主要是針對類比訊號積體電路SoC提供一套最適切的設計流程。並以業界最常見的Voltage Mode Buck Converter電路SoC設計當作範例。做為各界先進或新進入門的依據參考。基本上、我們從Voltage Mode Buck Converter的工作原理入手，並且導入工作區座標的概念 (X-Y工作範圍、訂定CCM/DCM區)與設定相關的驗證指標(Don)做為SoC設計檢討的依據。同時透過不同階段的工作軟體(Matlab與H-spice)逐步執行SoC的設計工作。更重要的是、我們更要對於

這些不同階段的設計結果的數據、做逐一比對式的檢討。只有這些比對結果越趨於一致，我們的SoC設計就越接近成功，我們在硬體生產(投片)的風險就越小。

切換式穩壓器的電磁干擾研究

為了解決dc to dc converter原理的問題，作者黃新凱 這樣論述：

本論文選用“致新科技”公司，型號G5684的Step Down DC-to-DC converter IC為例，探討改變切換頻率對輸出電壓漣波(Ripple)和電磁干擾(Electromagnetic Interference, EMI)問題的影響。由Switching Regulator的結構原理可知，輸出電壓漣波與頻率的平方成反比，提高切換頻率可降低漣波，電感亦可選用較低的電感值，而使印刷電路板(Printed circuit board, PCB)的使用面積下降。但是副作用就是其內部結構造成PWM週期切換時不是一完美的方波，在high-low急遽變化的地方，波形會產生震鈴(Ringin

g)，此ringing會疊加在輸出電壓波形上，造成雜訊干擾，實際量測EMI，結果隨著頻率升高而變糟。研究結果顯示，在輸出電壓端加上可抑制ringing雜訊的ferrite bead可達到抑制EMI的效果。